pico/pico_int.h

   1 /*\r
   2  * PicoDrive - Internal Header File\r
   3  * (c) Copyright Dave, 2004\r
   4  * (C) notaz, 2006-2010\r
   5  *\r
   6  * This work is licensed under the terms of MAME license.\r
   7  * See COPYING file in the top-level directory.\r
   8  */\r
   9 \r
  10 #ifndef PICO_INTERNAL_INCLUDED\r
  11 #define PICO_INTERNAL_INCLUDED\r
  12 \r
  13 #include <stdio.h>\r
  14 #include <stdlib.h>\r
  15 #include <string.h>\r
  16 #include "pico.h"\r
  17 #include "carthw/carthw.h"\r
  18 \r
  19 //\r
  20 #define USE_POLL_DETECT\r
  21 \r
  22 #ifndef PICO_INTERNAL\r
  23 #define PICO_INTERNAL\r
  24 #endif\r
  25 #ifndef PICO_INTERNAL_ASM\r
  26 #define PICO_INTERNAL_ASM\r
  27 #endif\r
  28 \r
  29 // to select core, define EMU_C68K, EMU_M68K or EMU_F68K in your makefile or project\r
  30 \r
  31 #ifdef __cplusplus\r
  32 extern "C" {\r
  33 #endif\r
  34 \r
  35 \r
  36 // ----------------------- 68000 CPU -----------------------\r
  37 #ifdef EMU_C68K\r
  38 #include "../cpu/Cyclone/Cyclone.h"\r
  39 extern struct Cyclone PicoCpuCM68k, PicoCpuCS68k;\r
  40 #define SekCyclesLeftNoMCD PicoCpuCM68k.cycles // cycles left for this run\r
  41 #define SekCyclesLeft \\r
  42         (((PicoAHW&1) && (PicoOpt & POPT_EN_MCD_PSYNC)) ? (SekCycleAim-SekCycleCnt) : SekCyclesLeftNoMCD)\r
  43 #define SekCyclesLeftS68k \\r
  44         ((PicoOpt & POPT_EN_MCD_PSYNC) ? (SekCycleAimS68k-SekCycleCntS68k) : PicoCpuCS68k.cycles)\r
  45 #define SekEndTimeslice(after) PicoCpuCM68k.cycles=after\r
  46 #define SekEndTimesliceS68k(after) PicoCpuCS68k.cycles=after\r
  47 #define SekPc (PicoCpuCM68k.pc-PicoCpuCM68k.membase)\r
  48 #define SekPcS68k (PicoCpuCS68k.pc-PicoCpuCS68k.membase)\r
  49 #define SekDar(x) PicoCpuCM68k.d[x]\r
  50 #define SekSr     CycloneGetSr(&PicoCpuCM68k)\r
  51 #define SekSetStop(x) { PicoCpuCM68k.state_flags&=~1; if (x) { PicoCpuCM68k.state_flags|=1; PicoCpuCM68k.cycles=0; } }\r
  52 #define SekSetStopS68k(x) { PicoCpuCS68k.state_flags&=~1; if (x) { PicoCpuCS68k.state_flags|=1; PicoCpuCS68k.cycles=0; } }\r
  53 #define SekIsStoppedS68k() (PicoCpuCS68k.state_flags&1)\r
  54 #define SekShouldInterrupt (PicoCpuCM68k.irq > (PicoCpuCM68k.srh&7))\r
  55 \r
  56 #define SekInterrupt(i) PicoCpuCM68k.irq=i\r
  57 #define SekIrqLevel     PicoCpuCM68k.irq\r
  58 \r
  59 #ifdef EMU_M68K\r
  60 #define EMU_CORE_DEBUG\r
  61 #endif\r
  62 #endif\r
  63 \r
  64 #ifdef EMU_F68K\r
  65 #include "../cpu/fame/fame.h"\r
  66 extern M68K_CONTEXT PicoCpuFM68k, PicoCpuFS68k;\r
  67 #define SekCyclesLeftNoMCD PicoCpuFM68k.io_cycle_counter\r
  68 #define SekCyclesLeft \\r
  69         (((PicoAHW&1) && (PicoOpt & POPT_EN_MCD_PSYNC)) ? (SekCycleAim-SekCycleCnt) : SekCyclesLeftNoMCD)\r
  70 #define SekCyclesLeftS68k \\r
  71         ((PicoOpt & POPT_EN_MCD_PSYNC) ? (SekCycleAimS68k-SekCycleCntS68k) : PicoCpuFS68k.io_cycle_counter)\r
  72 #define SekEndTimeslice(after) PicoCpuFM68k.io_cycle_counter=after\r
  73 #define SekEndTimesliceS68k(after) PicoCpuFS68k.io_cycle_counter=after\r
  74 #define SekPc     fm68k_get_pc(&PicoCpuFM68k)\r
  75 #define SekPcS68k fm68k_get_pc(&PicoCpuFS68k)\r
  76 #define SekDar(x) PicoCpuFM68k.dreg[x].D\r
  77 #define SekSr     PicoCpuFM68k.sr\r
  78 #define SekSetStop(x) { \\r
  79         PicoCpuFM68k.execinfo &= ~FM68K_HALTED; \\r
  80         if (x) { PicoCpuFM68k.execinfo |= FM68K_HALTED; PicoCpuFM68k.io_cycle_counter = 0; } \\r
  81 }\r
  82 #define SekSetStopS68k(x) { \\r
  83         PicoCpuFS68k.execinfo &= ~FM68K_HALTED; \\r
  84         if (x) { PicoCpuFS68k.execinfo |= FM68K_HALTED; PicoCpuFS68k.io_cycle_counter = 0; } \\r
  85 }\r
  86 #define SekIsStoppedS68k() (PicoCpuFS68k.execinfo&FM68K_HALTED)\r
  87 #define SekShouldInterrupt fm68k_would_interrupt()\r
  88 \r
  89 #define SekInterrupt(irq) PicoCpuFM68k.interrupts[0]=irq\r
  90 #define SekIrqLevel       PicoCpuFM68k.interrupts[0]\r
  91 \r
  92 #ifdef EMU_M68K\r
  93 #define EMU_CORE_DEBUG\r
  94 #endif\r
  95 #endif\r
  96 \r
  97 #ifdef EMU_M68K\r
  98 #include "../cpu/musashi/m68kcpu.h"\r
  99 extern m68ki_cpu_core PicoCpuMM68k, PicoCpuMS68k;\r
 100 #ifndef SekCyclesLeft\r
 101 #define SekCyclesLeftNoMCD PicoCpuMM68k.cyc_remaining_cycles\r
 102 #define SekCyclesLeft \\r
 103         (((PicoAHW&1) && (PicoOpt & POPT_EN_MCD_PSYNC)) ? (SekCycleAim-SekCycleCnt) : SekCyclesLeftNoMCD)\r
 104 #define SekCyclesLeftS68k \\r
 105         ((PicoOpt & POPT_EN_MCD_PSYNC) ? (SekCycleAimS68k-SekCycleCntS68k) : PicoCpuMS68k.cyc_remaining_cycles)\r
 106 #define SekEndTimeslice(after) SET_CYCLES(after)\r
 107 #define SekEndTimesliceS68k(after) PicoCpuMS68k.cyc_remaining_cycles=after\r
 108 #define SekPc m68k_get_reg(&PicoCpuMM68k, M68K_REG_PC)\r
 109 #define SekPcS68k m68k_get_reg(&PicoCpuMS68k, M68K_REG_PC)\r
 110 #define SekDar(x) PicoCpuMM68k.dar[x]\r
 111 #define SekSr m68k_get_reg(&PicoCpuMM68k, M68K_REG_SR)\r
 112 #define SekSetStop(x) { \\r
 113         if(x) { SET_CYCLES(0); PicoCpuMM68k.stopped=STOP_LEVEL_STOP; } \\r
 114         else PicoCpuMM68k.stopped=0; \\r
 115 }\r
 116 #define SekSetStopS68k(x) { \\r
 117         if(x) { SET_CYCLES(0); PicoCpuMS68k.stopped=STOP_LEVEL_STOP; } \\r
 118         else PicoCpuMS68k.stopped=0; \\r
 119 }\r
 120 #define SekIsStoppedS68k() (PicoCpuMS68k.stopped==STOP_LEVEL_STOP)\r
 121 #define SekShouldInterrupt (CPU_INT_LEVEL > FLAG_INT_MASK)\r
 122 \r
 123 #define SekInterrupt(irq) { \\r
 124         void *oldcontext = m68ki_cpu_p; \\r
 125         m68k_set_context(&PicoCpuMM68k); \\r
 126         m68k_set_irq(irq); \\r
 127         m68k_set_context(oldcontext); \\r
 128 }\r
 129 #define SekIrqLevel (PicoCpuMM68k.int_level >> 8)\r
 130 \r
 131 #endif\r
 132 #endif // EMU_M68K\r
 133 \r
 134 extern int SekCycleCnt; // cycles done in this frame\r
 135 extern int SekCycleAim; // cycle aim\r
 136 extern unsigned int SekCycleCntT; // total cycle counter, updated once per frame\r
 137 \r
 138 #define SekCyclesReset() { \\r
 139         SekCycleCntT+=SekCycleAim; \\r
 140         SekCycleCnt-=SekCycleAim; \\r
 141         SekCycleAim=0; \\r
 142 }\r
 143 #define SekCyclesBurn(c)  SekCycleCnt+=c\r
 144 #define SekCyclesDone()  (SekCycleAim-SekCyclesLeft)    // number of cycles done in this frame (can be checked anywhere)\r
 145 #define SekCyclesDoneT() (SekCycleCntT+SekCyclesDone()) // total nuber of cycles done for this rom\r
 146 \r
 147 #define SekEndRun(after) { \\r
 148         SekCycleCnt -= SekCyclesLeft - (after); \\r
 149         if (SekCycleCnt < 0) SekCycleCnt = 0; \\r
 150         SekEndTimeslice(after); \\r
 151 }\r
 152 \r
 153 #define SekEndRunS68k(after) { \\r
 154         SekCycleCntS68k -= SekCyclesLeftS68k - (after); \\r
 155         if (SekCycleCntS68k < 0) SekCycleCntS68k = 0; \\r
 156         SekEndTimesliceS68k(after); \\r
 157 }\r
 158 \r
 159 extern int SekCycleCntS68k;\r
 160 extern int SekCycleAimS68k;\r
 161 \r
 162 #define SekCyclesResetS68k() { \\r
 163         SekCycleCntS68k-=SekCycleAimS68k; \\r
 164         SekCycleAimS68k=0; \\r
 165 }\r
 166 #define SekCyclesDoneS68k()  (SekCycleAimS68k-SekCyclesLeftS68k)\r
 167 \r
 168 #ifdef EMU_CORE_DEBUG\r
 169 extern int dbg_irq_level;\r
 170 #undef SekEndTimeslice\r
 171 #undef SekCyclesBurn\r
 172 #undef SekEndRun\r
 173 #undef SekInterrupt\r
 174 #define SekEndTimeslice(c)\r
 175 #define SekCyclesBurn(c) c\r
 176 #define SekEndRun(c)\r
 177 #define SekInterrupt(irq) dbg_irq_level=irq\r
 178 #endif\r
 179 \r
 180 // ----------------------- Z80 CPU -----------------------\r
 181 \r
 182 #if defined(_USE_DRZ80)\r
 183 #include "../cpu/DrZ80/drz80.h"\r
 184 \r
 185 extern struct DrZ80 drZ80;\r
 186 \r
 187 #define z80_run(cycles)    ((cycles) - DrZ80Run(&drZ80, cycles))\r
 188 #define z80_run_nr(cycles) DrZ80Run(&drZ80, cycles)\r
 189 #define z80_int()          drZ80.Z80_IRQ = 1\r
 190 \r
 191 #define z80_cyclesLeft     drZ80.cycles\r
 192 #define z80_pc()           (drZ80.Z80PC - drZ80.Z80PC_BASE)\r
 193 \r
 194 #elif defined(_USE_CZ80)\r
 195 #include "../cpu/cz80/cz80.h"\r
 196 \r
 197 #define z80_run(cycles)    Cz80_Exec(&CZ80, cycles)\r
 198 #define z80_run_nr(cycles) Cz80_Exec(&CZ80, cycles)\r
 199 #define z80_int()          Cz80_Set_IRQ(&CZ80, 0, HOLD_LINE)\r
 200 \r
 201 #define z80_cyclesLeft     (CZ80.ICount - CZ80.ExtraCycles)\r
 202 #define z80_pc()           Cz80_Get_Reg(&CZ80, CZ80_PC)\r
 203 \r
 204 #else\r
 205 \r
 206 #define z80_run(cycles)    (cycles)\r
 207 #define z80_run_nr(cycles)\r
 208 #define z80_int()\r
 209 \r
 210 #endif\r
 211 \r
 212 #define Z80_STATE_SIZE 0x60\r
 213 \r
 214 extern int z80stopCycle;         /* in 68k cycles */\r
 215 extern int z80_cycle_cnt;        /* 'done' z80 cycles before z80_run() */\r
 216 extern int z80_cycle_aim;\r
 217 extern int z80_scanline;\r
 218 extern int z80_scanline_cycles;  /* cycles done until z80_scanline */\r
 219 \r
 220 #define z80_resetCycles() \\r
 221   z80_cycle_cnt = z80_cycle_aim = z80_scanline = z80_scanline_cycles = 0;\r
 222 \r
 223 #define z80_cyclesDone() \\r
 224   (z80_cycle_aim - z80_cyclesLeft)\r
 225 \r
 226 #define cycles_68k_to_z80(x) ((x)*957 >> 11)\r
 227 \r
 228 // ----------------------- SH2 CPU -----------------------\r
 229 \r
 230 #include "cpu/sh2/sh2.h"\r
 231 \r
 232 extern SH2 sh2s[2];\r
 233 #define msh2 sh2s[0]\r
 234 #define ssh2 sh2s[1]\r
 235 \r
 236 #ifndef DRC_SH2\r
 237 # define ash2_end_run(after) if (sh2->icount > (after)) sh2->icount = after\r
 238 # define ash2_cycles_done() (sh2->cycles_aim - sh2->icount)\r
 239 #else\r
 240 # define ash2_end_run(after) { \\r
 241    if ((sh2->sr >> 12) > (after)) \\r
 242      { sh2->sr &= 0xfff; sh2->sr |= (after) << 12; } \\r
 243 }\r
 244 # define ash2_cycles_done() (sh2->cycles_aim - (sh2->sr >> 12))\r
 245 #endif\r
 246 \r
 247 //#define sh2_pc(c)     (c) ? ssh2.ppc : msh2.ppc\r
 248 #define sh2_pc(c)     (c) ? ssh2.pc : msh2.pc\r
 249 #define sh2_reg(c, x) (c) ? ssh2.r[x] : msh2.r[x]\r
 250 #define sh2_gbr(c)    (c) ? ssh2.gbr : msh2.gbr\r
 251 #define sh2_vbr(c)    (c) ? ssh2.vbr : msh2.vbr\r
 252 #define sh2_sr(c)   (((c) ? ssh2.sr : msh2.sr) & 0xfff)\r
 253 \r
 254 #define sh2_set_gbr(c, v) \\r
 255   { if (c) ssh2.gbr = v; else msh2.gbr = v; }\r
 256 #define sh2_set_vbr(c, v) \\r
 257   { if (c) ssh2.vbr = v; else msh2.vbr = v; }\r
 258 \r
 259 // ---------------------------------------------------------\r
 260 \r
 261 // main oscillator clock which controls timing\r
 262 #define OSC_NTSC 53693100\r
 263 #define OSC_PAL  53203424\r
 264 \r
 265 struct PicoVideo\r
 266 {\r
 267   unsigned char reg[0x20];\r
 268   unsigned int command;       // 32-bit Command\r
 269   unsigned char pending;      // 1 if waiting for second half of 32-bit command\r
 270   unsigned char type;         // Command type (v/c/vsram read/write)\r
 271   unsigned short addr;        // Read/Write address\r
 272   int status;                 // Status bits\r
 273   unsigned char pending_ints; // pending interrupts: ??VH????\r
 274   signed char lwrite_cnt;     // VDP write count during active display line\r
 275   unsigned short v_counter;   // V-counter\r
 276   unsigned char pad[0x10];\r
 277 };\r
 278 \r
 279 struct PicoMisc\r
 280 {\r
 281   unsigned char rotate;\r
 282   unsigned char z80Run;\r
 283   unsigned char padTHPhase[2]; // 02 phase of gamepad TH switches\r
 284   unsigned short scanline;     // 04 0 to 261||311\r
 285   char dirtyPal;               // 06 Is the palette dirty (1 - change @ this frame, 2 - some time before)\r
 286   unsigned char hardware;      // 07 Hardware value for country\r
 287   unsigned char pal;           // 08 1=PAL 0=NTSC\r
 288   unsigned char sram_reg;      // 09 SRAM reg. See SRR_* below\r
 289   unsigned short z80_bank68k;  // 0a\r
 290   unsigned short pad0;\r
 291   unsigned char  pad1;\r
 292   unsigned char  z80_reset;    // 0f z80 reset held\r
 293   unsigned char  padDelay[2];  // 10 gamepad phase time outs, so we count a delay\r
 294   unsigned short eeprom_addr;  // EEPROM address register\r
 295   unsigned char  eeprom_cycle; // EEPROM cycle number\r
 296   unsigned char  eeprom_slave; // EEPROM slave word for X24C02 and better SRAMs\r
 297   unsigned char  eeprom_status;\r
 298   unsigned char  pad2;\r
 299   unsigned short dma_xfers;    // 18\r
 300   unsigned char  eeprom_wb[2]; // EEPROM latch/write buffer\r
 301   unsigned int  frame_count;   // 1c for movies and idle det\r
 302 };\r
 303 \r
 304 struct PicoMS\r
 305 {\r
 306   unsigned char carthw[0x10];\r
 307   unsigned char io_ctl;\r
 308   unsigned char pad[0x4f];\r
 309 };\r
 310 \r
 311 // some assembly stuff depend on these, do not touch!\r
 312 struct Pico\r
 313 {\r
 314   unsigned char ram[0x10000];  // 0x00000 scratch ram\r
 315   union {                      // vram is byteswapped for easier reads when drawing\r
 316     unsigned short vram[0x8000];  // 0x10000\r
 317     unsigned char  vramb[0x4000]; // VRAM in SMS mode\r
 318   };\r
 319   unsigned char zram[0x2000];  // 0x20000 Z80 ram\r
 320   unsigned char ioports[0x10]; // XXX: fix asm and mv\r
 321   unsigned char pad[0xf0];     // unused\r
 322   unsigned short cram[0x40];   // 0x22100\r
 323   unsigned short vsram[0x40];  // 0x22180\r
 324 \r
 325   unsigned char *rom;          // 0x22200\r
 326   unsigned int romsize;        // 0x22204\r
 327 \r
 328   struct PicoMisc m;\r
 329   struct PicoVideo video;\r
 330   struct PicoMS ms;\r
 331 };\r
 332 \r
 333 // sram\r
 334 #define SRR_MAPPED   (1 << 0)\r
 335 #define SRR_READONLY (1 << 1)\r
 336 \r
 337 #define SRF_ENABLED  (1 << 0)\r
 338 #define SRF_EEPROM   (1 << 1)\r
 339 \r
 340 struct PicoSRAM\r
 341 {\r
 342   unsigned char *data;          // actual data\r
 343   unsigned int start;           // start address in 68k address space\r
 344   unsigned int end;\r
 345   unsigned char flags;          // 0c: SRF_*\r
 346   unsigned char unused2;\r
 347   unsigned char changed;\r
 348   unsigned char eeprom_type;    // eeprom type: 0: 7bit (24C01), 2: 2 addr words (X24C02+), 3: 3 addr words\r
 349   unsigned char unused3;\r
 350   unsigned char eeprom_bit_cl;  // bit number for cl\r
 351   unsigned char eeprom_bit_in;  // bit number for in\r
 352   unsigned char eeprom_bit_out; // bit number for out\r
 353   unsigned int size;\r
 354 };\r
 355 \r
 356 // MCD\r
 357 #include "cd/cd_sys.h"\r
 358 #include "cd/LC89510.h"\r
 359 #include "cd/gfx_cd.h"\r
 360 \r
 361 struct mcd_pcm\r
 362 {\r
 363         unsigned char control; // reg7\r
 364         unsigned char enabled; // reg8\r
 365         unsigned char cur_ch;\r
 366         unsigned char bank;\r
 367         int pad1;\r
 368 \r
 369         struct pcm_chan                 // 08, size 0x10\r
 370         {\r
 371                 unsigned char regs[8];\r
 372                 unsigned int  addr;     // .08: played sample address\r
 373                 int pad;\r
 374         } ch[8];\r
 375 };\r
 376 \r
 377 struct mcd_misc\r
 378 {\r
 379         unsigned short hint_vector;\r
 380         unsigned char  busreq;\r
 381         unsigned char  s68k_pend_ints;\r
 382         unsigned int   state_flags;     // 04: emu state: reset_pending\r
 383         unsigned int   counter75hz;\r
 384         unsigned int   pad0;\r
 385         int            timer_int3;      // 10\r
 386         unsigned int   timer_stopwatch;\r
 387         unsigned char  bcram_reg;       // 18: battery-backed RAM cart register\r
 388         unsigned char  pad2;\r
 389         unsigned short pad3;\r
 390         int pad[9];\r
 391 };\r
 392 \r
 393 typedef struct\r
 394 {\r
 395         unsigned char bios[0x20000];                    // 000000: 128K\r
 396         union {                                         // 020000: 512K\r
 397                 unsigned char prg_ram[0x80000];\r
 398                 unsigned char prg_ram_b[4][0x20000];\r
 399         };\r
 400         union {                                         // 0a0000: 256K\r
 401                 struct {\r
 402                         unsigned char word_ram2M[0x40000];\r
 403                         unsigned char unused0[0x20000];\r
 404                 };\r
 405                 struct {\r
 406                         unsigned char unused1[0x20000];\r
 407                         unsigned char word_ram1M[2][0x20000];\r
 408                 };\r
 409         };\r
 410         union {                                         // 100000: 64K\r
 411                 unsigned char pcm_ram[0x10000];\r
 412                 unsigned char pcm_ram_b[0x10][0x1000];\r
 413         };\r
 414         unsigned char s68k_regs[0x200];                 // 110000: GA, not CPU regs\r
 415         unsigned char bram[0x2000];                     // 110200: 8K\r
 416         struct mcd_misc m;                              // 112200: misc\r
 417         struct mcd_pcm pcm;                             // 112240:\r
 418         _scd_toc TOC;                                   // not to be saved\r
 419         CDD  cdd;\r
 420         CDC  cdc;\r
 421         _scd scd;\r
 422         Rot_Comp rot_comp;\r
 423 } mcd_state;\r
 424 \r
 425 // XXX: this will need to be reworked for cart+cd support.\r
 426 #define Pico_mcd ((mcd_state *)Pico.rom)\r
 427 \r
 428 // 32X\r
 429 #define P32XS_FM    (1<<15)\r
 430 #define P32XS_REN   (1<< 7)\r
 431 #define P32XS_nRES  (1<< 1)\r
 432 #define P32XS_ADEN  (1<< 0)\r
 433 #define P32XS2_ADEN (1<< 9)\r
 434 #define P32XS_FULL  (1<< 7) // DREQ FIFO full\r
 435 #define P32XS_68S   (1<< 2)\r
 436 #define P32XS_DMA   (1<< 1)\r
 437 #define P32XS_RV    (1<< 0)\r
 438 \r
 439 #define P32XV_nPAL  (1<<15) // VDP\r
 440 #define P32XV_PRI   (1<< 7)\r
 441 #define P32XV_Mx    (3<< 0) // display mode mask\r
 442 \r
 443 #define P32XV_SFT   (1<< 0)\r
 444 \r
 445 #define P32XV_VBLK  (1<<15)\r
 446 #define P32XV_HBLK  (1<<14)\r
 447 #define P32XV_PEN   (1<<13)\r
 448 #define P32XV_nFEN  (1<< 1)\r
 449 #define P32XV_FS    (1<< 0)\r
 450 \r
 451 #define P32XP_FULL  (1<<15) // PWM\r
 452 #define P32XP_EMPTY (1<<14)\r
 453 \r
 454 #define P32XF_68KPOLL   (1 << 0)\r
 455 #define P32XF_MSH2POLL  (1 << 1)\r
 456 #define P32XF_SSH2POLL  (1 << 2)\r
 457 #define P32XF_68KVPOLL  (1 << 3)\r
 458 #define P32XF_MSH2VPOLL (1 << 4)\r
 459 #define P32XF_SSH2VPOLL (1 << 5)\r
 460 \r
 461 #define P32XI_VRES (1 << 14/2) // IRL/2\r
 462 #define P32XI_VINT (1 << 12/2)\r
 463 #define P32XI_HINT (1 << 10/2)\r
 464 #define P32XI_CMD  (1 <<  8/2)\r
 465 #define P32XI_PWM  (1 <<  6/2)\r
 466 \r
 467 // peripheral reg access\r
 468 #define PREG8(regs,offs) ((unsigned char *)regs)[offs ^ 3]\r
 469 \r
 470 // real one is 4*2, but we use more because we don't lockstep\r
 471 #define DMAC_FIFO_LEN (4*4)\r
 472 #define PWM_BUFF_LEN 1024 // in one channel samples\r
 473 \r
 474 #define SH2_DRCBLK_RAM_SHIFT 1\r
 475 #define SH2_DRCBLK_DA_SHIFT  1\r
 476 \r
 477 #define SH2_WRITE_SHIFT 25\r
 478 \r
 479 struct Pico32x\r
 480 {\r
 481   unsigned short regs[0x20];\r
 482   unsigned short vdp_regs[0x10]; // 0x40\r
 483   unsigned short sh2_regs[3];    // 0x60\r
 484   unsigned char pending_fb;\r
 485   unsigned char dirty_pal;\r
 486   unsigned int emu_flags;\r
 487   unsigned char sh2irq_mask[2];\r
 488   unsigned char sh2irqi[2];      // individual\r
 489   unsigned int sh2irqs;          // common irqs\r
 490   unsigned short dmac_fifo[DMAC_FIFO_LEN];\r
 491   unsigned int dmac_ptr;\r
 492   unsigned int pwm_irq_sample_cnt;\r
 493   unsigned int reserved[9];\r
 494 };\r
 495 \r
 496 struct Pico32xMem\r
 497 {\r
 498   unsigned char  sdram[0x40000];\r
 499 #ifdef DRC_SH2\r
 500   unsigned short drcblk_ram[1 << (18 - SH2_DRCBLK_RAM_SHIFT)];\r
 501 #endif\r
 502   unsigned short dram[2][0x20000/2];    // AKA fb\r
 503   union {\r
 504     unsigned char  m68k_rom[0x100];\r
 505     unsigned char  m68k_rom_bank[0x10000]; // M68K_BANK_SIZE\r
 506   };\r
 507   unsigned char  data_array[2][0x1000]; // cache in SH2s (can be used as RAM)\r
 508 #ifdef DRC_SH2\r
 509   unsigned short drcblk_da[2][1 << (12 - SH2_DRCBLK_DA_SHIFT)];\r
 510 #endif\r
 511   unsigned char  sh2_rom_m[0x800];\r
 512   unsigned char  sh2_rom_s[0x400];\r
 513   unsigned short pal[0x100];\r
 514   unsigned short pal_native[0x100];     // converted to native (for renderer)\r
 515   unsigned int   sh2_peri_regs[2][0x200/4]; // periphereal regs of SH2s\r
 516   signed short   pwm[2*PWM_BUFF_LEN];   // PWM buffer for current frame\r
 517 };\r
 518 \r
 519 // area.c\r
 520 extern void (*PicoLoadStateHook)(void);\r
 521 \r
 522 typedef struct {\r
 523         int chunk;\r
 524         int size;\r
 525         void *ptr;\r
 526 } carthw_state_chunk;\r
 527 extern carthw_state_chunk *carthw_chunks;\r
 528 #define CHUNK_CARTHW 64\r
 529 \r
 530 // cart.c\r
 531 extern int PicoCartResize(int newsize);\r
 532 extern void Byteswap(void *dst, const void *src, int len);\r
 533 extern void (*PicoCartMemSetup)(void);\r
 534 extern void (*PicoCartUnloadHook)(void);\r
 535 \r
 536 // debug.c\r
 537 int CM_compareRun(int cyc, int is_sub);\r
 538 \r
 539 // draw.c\r
 540 PICO_INTERNAL void PicoFrameStart(void);\r
 541 void PicoDrawSync(int to, int blank_last_line);\r
 542 void BackFill(int reg7, int sh);\r
 543 void FinalizeLine555(int sh, int line);\r
 544 extern int (*PicoScanBegin)(unsigned int num);\r
 545 extern int (*PicoScanEnd)(unsigned int num);\r
 546 extern int DrawScanline;\r
 547 #define MAX_LINE_SPRITES 29\r
 548 extern unsigned char HighLnSpr[240][3 + MAX_LINE_SPRITES];\r
 549 extern void *DrawLineDestBase;\r
 550 extern int DrawLineDestIncrement;\r
 551 \r
 552 // draw2.c\r
 553 PICO_INTERNAL void PicoFrameFull();\r
 554 \r
 555 // mode4.c\r
 556 void PicoFrameStartMode4(void);\r
 557 void PicoLineMode4(int line);\r
 558 void PicoDoHighPal555M4(void);\r
 559 void PicoDrawSetOutputMode4(pdso_t which);\r
 560 \r
 561 // memory.c\r
 562 PICO_INTERNAL void PicoMemSetup(void);\r
 563 unsigned int PicoRead8_io(unsigned int a);\r
 564 unsigned int PicoRead16_io(unsigned int a);\r
 565 void PicoWrite8_io(unsigned int a, unsigned int d);\r
 566 void PicoWrite16_io(unsigned int a, unsigned int d);\r
 567 \r
 568 // pico/memory.c\r
 569 PICO_INTERNAL void PicoMemSetupPico(void);\r
 570 \r
 571 // cd/memory.c\r
 572 PICO_INTERNAL void PicoMemSetupCD(void);\r
 573 void PicoMemStateLoaded(void);\r
 574 \r
 575 // pico.c\r
 576 extern struct Pico Pico;\r
 577 extern struct PicoSRAM SRam;\r
 578 extern int PicoPadInt[2];\r
 579 extern int emustatus;\r
 580 extern int scanlines_total;\r
 581 extern void (*PicoResetHook)(void);\r
 582 extern void (*PicoLineHook)(void);\r
 583 PICO_INTERNAL int  CheckDMA(void);\r
 584 PICO_INTERNAL void PicoDetectRegion(void);\r
 585 PICO_INTERNAL void PicoSyncZ80(int m68k_cycles_done);\r
 586 \r
 587 // cd/pico.c\r
 588 PICO_INTERNAL void PicoInitMCD(void);\r
 589 PICO_INTERNAL void PicoExitMCD(void);\r
 590 PICO_INTERNAL void PicoPowerMCD(void);\r
 591 PICO_INTERNAL int  PicoResetMCD(void);\r
 592 PICO_INTERNAL void PicoFrameMCD(void);\r
 593 \r
 594 // pico/pico.c\r
 595 PICO_INTERNAL void PicoInitPico(void);\r
 596 PICO_INTERNAL void PicoReratePico(void);\r
 597 \r
 598 // pico/xpcm.c\r
 599 PICO_INTERNAL void PicoPicoPCMUpdate(short *buffer, int length, int stereo);\r
 600 PICO_INTERNAL void PicoPicoPCMReset(void);\r
 601 PICO_INTERNAL void PicoPicoPCMRerate(int xpcm_rate);\r
 602 \r
 603 // sek.c\r
 604 PICO_INTERNAL void SekInit(void);\r
 605 PICO_INTERNAL int  SekReset(void);\r
 606 PICO_INTERNAL void SekState(int *data);\r
 607 PICO_INTERNAL void SekSetRealTAS(int use_real);\r
 608 PICO_INTERNAL void SekPackCpu(unsigned char *cpu, int is_sub);\r
 609 PICO_INTERNAL void SekUnpackCpu(const unsigned char *cpu, int is_sub);\r
 610 void SekStepM68k(void);\r
 611 void SekInitIdleDet(void);\r
 612 void SekFinishIdleDet(void);\r
 613 \r
 614 // cd/sek.c\r
 615 PICO_INTERNAL void SekInitS68k(void);\r
 616 PICO_INTERNAL int  SekResetS68k(void);\r
 617 PICO_INTERNAL int  SekInterruptS68k(int irq);\r
 618 \r
 619 // sound/sound.c\r
 620 PICO_INTERNAL void cdda_start_play();\r
 621 extern short cdda_out_buffer[2*1152];\r
 622 extern int PsndLen_exc_cnt;\r
 623 extern int PsndLen_exc_add;\r
 624 extern int timer_a_next_oflow, timer_a_step; // in z80 cycles\r
 625 extern int timer_b_next_oflow, timer_b_step;\r
 626 \r
 627 void ym2612_sync_timers(int z80_cycles, int mode_old, int mode_new);\r
 628 void ym2612_pack_state(void);\r
 629 void ym2612_unpack_state(void);\r
 630 \r
 631 #define TIMER_NO_OFLOW 0x70000000\r
 632 // tA =   72 * (1024 - NA) / M\r
 633 #define TIMER_A_TICK_ZCYCLES  17203\r
 634 // tB = 1152 * (256 - NA) / M\r
 635 #define TIMER_B_TICK_ZCYCLES 262800 // 275251 broken, see Dai Makaimura\r
 636 \r
 637 #define timers_cycle() \\r
 638   if (timer_a_next_oflow > 0 && timer_a_next_oflow < TIMER_NO_OFLOW) \\r
 639     timer_a_next_oflow -= Pico.m.pal ? 70938*256 : 59659*256; \\r
 640   if (timer_b_next_oflow > 0 && timer_b_next_oflow < TIMER_NO_OFLOW) \\r
 641     timer_b_next_oflow -= Pico.m.pal ? 70938*256 : 59659*256; \\r
 642   ym2612_sync_timers(0, ym2612.OPN.ST.mode, ym2612.OPN.ST.mode);\r
 643 \r
 644 #define timers_reset() \\r
 645   timer_a_next_oflow = timer_b_next_oflow = TIMER_NO_OFLOW; \\r
 646   timer_a_step = TIMER_A_TICK_ZCYCLES * 1024; \\r
 647   timer_b_step = TIMER_B_TICK_ZCYCLES * 256;\r
 648 \r
 649 \r
 650 // videoport.c\r
 651 PICO_INTERNAL_ASM void PicoVideoWrite(unsigned int a,unsigned short d);\r
 652 PICO_INTERNAL_ASM unsigned int PicoVideoRead(unsigned int a);\r
 653 PICO_INTERNAL_ASM unsigned int PicoVideoRead8(unsigned int a);\r
 654 extern int (*PicoDmaHook)(unsigned int source, int len, unsigned short **srcp, unsigned short **limitp);\r
 655 \r
 656 // misc.c\r
 657 PICO_INTERNAL_ASM void memcpy16(unsigned short *dest, unsigned short *src, int count);\r
 658 PICO_INTERNAL_ASM void memcpy16bswap(unsigned short *dest, void *src, int count);\r
 659 PICO_INTERNAL_ASM void memcpy32(int *dest, int *src, int count); // 32bit word count\r
 660 PICO_INTERNAL_ASM void memset32(int *dest, int c, int count);\r
 661 \r
 662 // eeprom.c\r
 663 void EEPROM_write8(unsigned int a, unsigned int d);\r
 664 void EEPROM_write16(unsigned int d);\r
 665 unsigned int EEPROM_read(void);\r
 666 \r
 667 // z80 functionality wrappers\r
 668 PICO_INTERNAL void z80_init(void);\r
 669 PICO_INTERNAL void z80_pack(void *data);\r
 670 PICO_INTERNAL int  z80_unpack(const void *data);\r
 671 PICO_INTERNAL void z80_reset(void);\r
 672 PICO_INTERNAL void z80_exit(void);\r
 673 \r
 674 // cd/misc.c\r
 675 PICO_INTERNAL_ASM void wram_2M_to_1M(unsigned char *m);\r
 676 PICO_INTERNAL_ASM void wram_1M_to_2M(unsigned char *m);\r
 677 \r
 678 // cd/buffering.c\r
 679 PICO_INTERNAL void PicoCDBufferRead(void *dest, int lba);\r
 680 \r
 681 // sound/sound.c\r
 682 PICO_INTERNAL void PsndReset(void);\r
 683 PICO_INTERNAL void PsndDoDAC(int line_to);\r
 684 PICO_INTERNAL void PsndClear(void);\r
 685 PICO_INTERNAL void PsndGetSamples(int y);\r
 686 PICO_INTERNAL void PsndGetSamplesMS(void);\r
 687 extern int PsndDacLine;\r
 688 \r
 689 // sms.c\r
 690 #ifndef NO_SMS\r
 691 void PicoPowerMS(void);\r
 692 void PicoResetMS(void);\r
 693 void PicoMemSetupMS(void);\r
 694 void PicoStateLoadedMS(void);\r
 695 void PicoFrameMS(void);\r
 696 void PicoFrameDrawOnlyMS(void);\r
 697 #else\r
 698 #define PicoPowerMS()\r
 699 #define PicoResetMS()\r
 700 #define PicoMemSetupMS()\r
 701 #define PicoStateLoadedMS()\r
 702 #define PicoFrameMS()\r
 703 #define PicoFrameDrawOnlyMS()\r
 704 #endif\r
 705 \r
 706 // 32x/32x.c\r
 707 #ifndef NO_32X\r
 708 extern struct Pico32x Pico32x;\r
 709 void Pico32xInit(void);\r
 710 void PicoPower32x(void);\r
 711 void PicoReset32x(void);\r
 712 void Pico32xStartup(void);\r
 713 void PicoUnload32x(void);\r
 714 void PicoFrame32x(void);\r
 715 void p32x_update_irls(int nested_call);\r
 716 void p32x_reset_sh2s(void);\r
 717 \r
 718 // 32x/memory.c\r
 719 struct Pico32xMem *Pico32xMem;\r
 720 unsigned int PicoRead8_32x(unsigned int a);\r
 721 unsigned int PicoRead16_32x(unsigned int a);\r
 722 void PicoWrite8_32x(unsigned int a, unsigned int d);\r
 723 void PicoWrite16_32x(unsigned int a, unsigned int d);\r
 724 void PicoMemSetup32x(void);\r
 725 void Pico32xSwapDRAM(int b);\r
 726 void Pico32xStateLoaded(void);\r
 727 void p32x_poll_event(int cpu_mask, int is_vdp);\r
 728 \r
 729 // 32x/draw.c\r
 730 void FinalizeLine32xRGB555(int sh, int line);\r
 731 void PicoDraw32xLayer(int offs, int lines, int mdbg);\r
 732 void PicoDraw32xLayerMdOnly(int offs, int lines);\r
 733 extern int (*PicoScan32xBegin)(unsigned int num);\r
 734 extern int (*PicoScan32xEnd)(unsigned int num);\r
 735 enum {\r
 736   PDM32X_OFF,\r
 737   PDM32X_32X_ONLY,\r
 738   PDM32X_BOTH,\r
 739 };\r
 740 extern int Pico32xDrawMode;\r
 741 \r
 742 // 32x/pwm.c\r
 743 unsigned int p32x_pwm_read16(unsigned int a);\r
 744 void p32x_pwm_write16(unsigned int a, unsigned int d);\r
 745 void p32x_pwm_update(int *buf32, int length, int stereo);\r
 746 void p32x_timers_do(int line_call);\r
 747 void p32x_timers_recalc(void);\r
 748 extern int pwm_frame_smp_cnt;\r
 749 #else\r
 750 #define Pico32xInit()\r
 751 #define PicoPower32x()\r
 752 #define PicoReset32x()\r
 753 #define PicoFrame32x()\r
 754 #define PicoUnload32x()\r
 755 #define Pico32xStateLoaded()\r
 756 #define PicoDraw32xSetFrameMode(...)\r
 757 #define FinalizeLine32xRGB555 NULL\r
 758 #define p32x_pwm_update(...)\r
 759 #define p32x_timers_recalc()\r
 760 #endif\r
 761 \r
 762 /* avoid dependency on newer glibc */\r
 763 static __inline int isspace_(int c)\r
 764 {\r
 765         return (0x09 <= c && c <= 0x0d) || c == ' ';\r
 766 }\r
 767 \r
 768 #ifndef ARRAY_SIZE\r
 769 #define ARRAY_SIZE(x) (sizeof(x) / sizeof(x[0]))\r
 770 #endif\r
 771 \r
 772 // emulation event logging\r
 773 #ifndef EL_LOGMASK\r
 774 #define EL_LOGMASK 0\r
 775 #endif\r
 776 \r
 777 #define EL_HVCNT   0x00000001 /* hv counter reads */\r
 778 #define EL_SR      0x00000002 /* SR reads */\r
 779 #define EL_INTS    0x00000004 /* ints and acks */\r
 780 #define EL_YMTIMER 0x00000008 /* ym2612 timer stuff */\r
 781 #define EL_INTSW   0x00000010 /* log irq switching on/off */\r
 782 #define EL_ASVDP   0x00000020 /* VDP accesses during active scan */\r
 783 #define EL_VDPDMA  0x00000040 /* VDP DMA transfers and their timing */\r
 784 #define EL_BUSREQ  0x00000080 /* z80 busreq r/w or reset w */\r
 785 #define EL_Z80BNK  0x00000100 /* z80 i/o through bank area */\r
 786 #define EL_SRAMIO  0x00000200 /* sram i/o */\r
 787 #define EL_EEPROM  0x00000400 /* eeprom debug */\r
 788 #define EL_UIO     0x00000800 /* unmapped i/o */\r
 789 #define EL_IO      0x00001000 /* all i/o */\r
 790 #define EL_CDPOLL  0x00002000 /* MCD: log poll detection */\r
 791 #define EL_SVP     0x00004000 /* SVP stuff */\r
 792 #define EL_PICOHW  0x00008000 /* Pico stuff */\r
 793 #define EL_IDLE    0x00010000 /* idle loop det. */\r
 794 #define EL_CDREGS  0x00020000 /* MCD: register access */\r
 795 #define EL_CDREG3  0x00040000 /* MCD: register 3 only */\r
 796 #define EL_32X     0x00080000\r
 797 #define EL_PWM     0x00100000 /* 32X PWM stuff (LOTS of output) */\r
 798 \r
 799 #define EL_STATUS  0x40000000 /* status messages */\r
 800 #define EL_ANOMALY 0x80000000 /* some unexpected conditions (during emulation) */\r
 801 \r
 802 #if EL_LOGMASK\r
 803 extern void lprintf(const char *fmt, ...);\r
 804 #define elprintf(w,f,...) \\r
 805 { \\r
 806         if ((w) & EL_LOGMASK) \\r
 807                 lprintf("%05i:%03i: " f "\n",Pico.m.frame_count,Pico.m.scanline,##__VA_ARGS__); \\r
 808 }\r
 809 #elif defined(_MSC_VER)\r
 810 #define elprintf\r
 811 #else\r
 812 #define elprintf(w,f,...)\r
 813 #endif\r
 814 \r
 815 // profiling\r
 816 #ifdef PPROF\r
 817 #include <platform/linux/pprof.h>\r
 818 #else\r
 819 #define pprof_init()\r
 820 #define pprof_finish()\r
 821 #define pprof_start(x)\r
 822 #define pprof_end(...)\r
 823 #define pprof_end_sub(...)\r
 824 #endif\r
 825 \r
 826 // misc\r
 827 #ifdef _MSC_VER\r
 828 #define cdprintf\r
 829 #else\r
 830 #define cdprintf(x...)\r
 831 #endif\r
 832 \r
 833 #ifdef __i386__\r
 834 #define REGPARM(x) __attribute__((regparm(x)))\r
 835 #else\r
 836 #define REGPARM(x)\r
 837 #endif\r
 838 \r
 839 #ifdef __GNUC__\r
 840 #define NOINLINE __attribute__((noinline))\r
 841 #else\r
 842 #define NOINLINE\r
 843 #endif\r
 844 \r
 845 #ifdef __cplusplus\r
 846 } // End of extern "C"\r
 847 #endif\r
 848 \r
 849 #endif // PICO_INTERNAL_INCLUDED\r
 850 \r